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dc.contributor.advisorGarcía-Ramírez, Ronnyes
dc.contributor.authorRetana-Corrales, Luis Felipe
dc.date.accessioned2019-03-15T21:15:44Z
dc.date.available2019-03-15T21:15:44Z
dc.date.issued2018
dc.identifier.urihttps://hdl.handle.net/2238/10422
dc.descriptionProyecto de Graduación (Licenciatura en Ingeniería Electrónica) Instituto Tecnológico de Costa Rica, Escuela de Ingeniería Electrónica, 2018.es
dc.description.abstractThis document establishes a comparison between two di erent topologies for the IEE 1149.1 standard implementation. It is expected to give all the theoretical tools required to understand the design as well as to establish a comparison of each of the topological implementations in order to conclude which implementation is more e cient in terms of area consumption, energy consumption and speed.es
dc.description.abstractEn este proyecto se establece un punto de comparación entre dos implementaciones topológicas diferentes para el estándar 1149.1 de la IEEE. Se espera brindar todas las herramientas teóricas necesarias para comprender el diseño con la finalidad de establecer una equiparación de las topologías utilizadas con la finalidad de concluir cuál implementación es más eficiente en términos de consumo de área, consumo de energía y velocidad.
dc.language.isospaes
dc.publisherInstituto Tecnológico de Costa Ricaes
dc.subjectFrecuenciaes
dc.subjectOperacioneses
dc.subjectCeldases
dc.subjectCadenases
dc.subjectValidaciónes
dc.subjectDiseñoes
dc.subjectFlipes
dc.subjectIntegraciónes
dc.subjectResearch Subject Categories::TECHNOLOGY::Electrical engineering, electronics and photonics::Electronicses
dc.titleDiseño de una implementación eficiente en el área de latches pulsados para la técnica Boundary Scan Informees
dc.typelicentiateThesises


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