Tecnológico de Costa Rica
  • ¿Cómo publicar en el Repositorio TEC?
  • Políticas
  • Recursos Educativos
  • Contáctenos
    • español
    • English
  • español 
    • español
    • English
  • Login
Ver ítem 
  •   Página Principal
  • Trabajos de Graduación
  • Biblioteca José Figueres Ferrer
  • Escuela de Ingeniería Electrónica
  • Maestría en Electrónica
  • Ver ítem
  •   Página Principal
  • Trabajos de Graduación
  • Biblioteca José Figueres Ferrer
  • Escuela de Ingeniería Electrónica
  • Maestría en Electrónica
  • Ver ítem
JavaScript is disabled for your browser. Some features of this site may not work without it.

Listar

Todo el RepositorioComunidades & ColeccionesPor fecha de publicaciónAutoresTítulosPalabras clavesTipo de Recurso EducativoDestinatarioEsta colecciónPor fecha de publicaciónAutoresTítulosPalabras clavesTipo de Recurso EducativoDestinatario

Mi cuenta

AccederRegistro

Estadísticas

Ver Estadísticas de uso

Optimización de protocolos de comunicación SDR ejecutados en FPGA

Thumbnail
Ver/
electrical_impedance_tomography_image_reconstruction.pdf (7.670Mb)
Fecha
2015
Autor
Moreno-Urbina, Harold Daniel
Metadatos
Mostrar el registro completo del ítem
Resumen
This project shows a methodology for the optimization digital communication systems implemented on software radios SDR reducing the CPU and memory usage. The project was developed using the kit Zedboard which is based on Xilinx Zynq 7000 series SoC. This SoC is known as hybrid because it counts with a processing systems, PS, based on a ARM processor and a programmable logic based on a FPGA. The PS executes GNU Radio software under a Linux operating System and for the optimizations the communication blocks are implemented on hardware. To communicate PS and PL the Xillybus interface is used. Using Xilinx software tools two commonly used blocks for digital communication transmission and receptors are implemented: a FIR filter and a FFT. Those blocks replace GNU Radio software blocks that perform the same functionality, allowing to execute the same implementation with two different approaches, one completely on software and one on a hybrid system. Memory and CPU usage of the Zedboard for two blocks with the same functionality are compared, the first case is a block running entirely in software and the second in the hybrid system. For FIR filters with 5, 13 and 25 taps CPU usage was 4.52%, 77.73% y 66.92% respectively, the memory usage measured was 25%; for the hybrid system CPU usage is reduced to the values between 15.27%, 8.68% y 4.87% respectively with a memory usage of 24%. For FFT CPU usage was reduced from 96.00% to 32.255% with reduced memory usage from 29% to 24%.
Descripción
Proyecto de Graduación (Maestría en Electrónica) Instituto Tecnológico de Costa Rica, Escuela de Ingeniería Electrónica, 2015.
URI
https://hdl.handle.net/2238/7140
Compartir
       
Métricas
Colecciones
  • Maestría en Electrónica [49]

|Contáctenos

Repositorio Institucional del Tecnológico de Costa Rica

Sistema de Bibliotecas del TEC | SIBITEC

© DERECHOS RESERVADOS. Un sitio soportado por DSpace(v. 6.3)

RT-1

 

 


|Contáctenos

Repositorio Institucional del Tecnológico de Costa Rica

Sistema de Bibliotecas del TEC | SIBITEC

© DERECHOS RESERVADOS. Un sitio soportado por DSpace(v. 6.3)

RT-1